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Ji Yoon Choi
Hosted Weblate
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c6ed3b2e35
commit
a9ed0a1562
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@ -1,11 +1,12 @@
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# Tokita, Hiroshi <tokita.hiroshi@gmail.com>, 2021.
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# Ji Yoon Choi <chichoon.choi@gmail.com>, 2021.
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msgid ""
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msgstr ""
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"Project-Id-Version: kicad\n"
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"Report-Msgid-Bugs-To: \n"
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"POT-Creation-Date: 2021-07-19 08:40-0700\n"
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"PO-Revision-Date: 2021-08-09 02:20+0000\n"
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||||
"Last-Translator: Tokita, Hiroshi <tokita.hiroshi@gmail.com>\n"
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"PO-Revision-Date: 2021-08-13 15:17+0000\n"
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||||
"Last-Translator: Ji Yoon Choi <chichoon.choi@gmail.com>\n"
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"Language-Team: Japanese <https://hosted.weblate.org/projects/kicad/"
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"master-source/ja/>\n"
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"Language: ja\n"
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@ -11965,7 +11966,6 @@ msgstr "不正な行の定義"
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#: eeschema/dialogs/panel_sym_lib_table.cpp:358
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#: pcbnew/dialogs/panel_fp_lib_table.cpp:539
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#, fuzzy
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msgid ""
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"Empty cells will result in all rows that are invalid to be removed from the "
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"table."
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@ -13640,9 +13640,8 @@ msgid "No parent for extended symbol %s"
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msgstr "親のない拡張されたシンボル %s"
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#: eeschema/sch_plugins/kicad/sch_sexpr_parser.cpp:275
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#, fuzzy
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msgid "Invalid symbol unit name"
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msgstr "不正な信号名"
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msgstr "不正なシンボルユニット名"
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#: eeschema/sch_plugins/kicad/sch_sexpr_parser.cpp:283
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#, c-format
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@ -14352,15 +14351,14 @@ msgstr ""
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"階層のどこかで親シートとしてサブシートの一つに持っています。"
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#: eeschema/sheet.cpp:84
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#, fuzzy, c-format
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#, c-format
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msgid ""
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"The schematic '%s' has not had its symbol library links remapped to the "
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"symbol library table. The project this schematic belongs to must first be "
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"remapped before it can be imported into the current project."
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msgstr ""
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"回路図 '%s' はシンボル ライブラリー テーブルに再マップされたシンボル ライブラ"
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"リーのリンクを持っていません。 現在のプロジェクトにインポートできるよう、こ"
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"の回路図が属しているプロジェクトは最初に再マップされなければなりません。"
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||||
"回路図 '%s' はシンボルライブラリー テーブルに再マップされたシンボルライブラリーのリンクを持っていません。 "
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||||
"現在のプロジェクトにインポートできるよう、この回路図が属しているプロジェクトは最初に再マップされなければなりません。"
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||||
#: eeschema/sheet.cpp:147
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msgid ""
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@ -16895,13 +16893,13 @@ msgstr ""
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"<b>未ロード:</b> <i>%s</i>"
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#: gerbview/files.cpp:42
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#, fuzzy, c-format
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#, c-format
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msgid ""
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"\n"
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"<b>Memory was exhausted reading:</b> <i>%s</i>"
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msgstr ""
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"\n"
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"<b>未ロード:</b> <i>%s</i>"
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"<b> <i>%s</i>を読み込み中メモリー不足</b>"
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||||
#: gerbview/files.cpp:87
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msgid "Zip files"
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@ -20335,9 +20333,8 @@ msgid "Enter expected board thickness in %s (min value %s)"
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msgstr "単位 %s で希望する基板の厚さを入力 (最小値は %s)"
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#: pcbnew/board_stackup_manager/panel_board_stackup.cpp:182
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#, fuzzy
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msgid "Adjust not locked dielectric thickness layers"
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msgstr "基板厚から誘電体厚を更新"
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msgstr "ロックされていない誘電体厚レイヤーを更新"
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#: pcbnew/board_stackup_manager/panel_board_stackup.cpp:193
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#, c-format
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@ -20345,9 +20342,8 @@ msgid "Too small value (min value %s %s). Aborted"
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msgstr "値が小さすぎます（最小値%s %s）。中止します"
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#: pcbnew/board_stackup_manager/panel_board_stackup.cpp:213
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#, fuzzy
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msgid "All dielectric thickness layers are locked"
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msgstr "基板厚から誘電体厚を更新"
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msgstr "全ての誘電体厚レイヤーはロックされています"
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#: pcbnew/board_stackup_manager/panel_board_stackup.cpp:279
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#, c-format
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@ -21660,9 +21656,8 @@ msgid "Clearance:"
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msgstr "クリアランス:"
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#: pcbnew/dialogs/dialog_copper_zones_base.cpp:182
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#, fuzzy
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msgid "Copper clearance for this zone (set to 0 to use the netclass clearance)"
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msgstr "ネットクラスの値を使用するため、クリアランスを０に設定"
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msgstr "このゾーンの導体クリアランス（０に設定すると、ネットクラスクリアランスを使用）"
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#: pcbnew/dialogs/dialog_copper_zones_base.cpp:193
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#: pcbnew/dialogs/dialog_non_copper_zones_properties_base.cpp:67
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@ -22617,7 +22612,6 @@ msgid ""
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msgstr "スケールされたモデルが検出されました。 モデルのスケーリングは、機械向けのエクスポートとして信頼できるものではありません。"
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#: pcbnew/dialogs/dialog_export_step.cpp:191
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#, fuzzy
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msgid "Model Scale Warning"
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msgstr "モデルスケールの警告"
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@ -25320,11 +25314,10 @@ msgstr ""
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"ん。 "
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#: pcbnew/dialogs/dialog_plot_base.cpp:173
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#, fuzzy
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msgid ""
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"Most board houses expect 0 and use their constraints, especially for solder "
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"mask min width."
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msgstr "0 を指定し、特にハンダ マスクの最小幅に対して制約を使用します。"
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msgstr "ほとんどの基板メーカーは0 と見做して、特にハンダマスクの最小幅に対して制約を使います。"
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#: pcbnew/dialogs/dialog_plot_base.cpp:183
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msgid "Board setup"
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@ -28132,7 +28125,6 @@ msgid "Drilled holes too close together"
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msgstr "ドリル穴が近過ぎる"
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#: pcbnew/drc/drc_item.cpp:101
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#, fuzzy
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msgid "Drilled holes co-located"
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msgstr "ドリル穴が近過ぎる"
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